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电脑与电信  2016, Vol. 1 Issue (4): 69-71    
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多通道像素并行输出哈特曼波前传感器 的实时质心运算流水线架构设计
宋璐1,王少白2
河南科技大学,河南洛阳471023; 2.中国航空工业集团公司洛阳电光设备研究所
Pipeline Structure Design for Real-time Centroid Calculation of HartmannWavefront Sensor with Parallel Multi-channel Pixel Output
Song Lu1,Wang Shaobai2
Henan University of Science and Technology, Luoyang 471009,Henan; 2. Luoyang Institute of Electro-optical Equipment of AVIC
全文: PDF(0 KB)  
输出: BibTeX | EndNote (RIS)      
摘要 基于可编程逻辑器件,设计了一种针对横向多通道像素并行输出特点的哈特曼波前传感器的实时质心运算流 水线架构。该架构由乘法器单元、累加单元和除法单元组成,各个单元内运算器的数目可根据输出通道数和输出像素顺序自 由配置。对于一帧图像的质心运算,经过该架构处理后延时仅为对最后输出的一个像素处理所需时间。仿真结果表明,对于 以80MHz 的时钟频率,横向8 个像素并行输出的哈特曼波前传感器,其运算延时不超过0.5μs。
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宋璐
王少白
关键词 质心运算并行像素输出可编程逻辑器件哈特曼波前传感器    
Abstract:In this paper, a real-time pipeline centroid calculating structure based on programmable logic devices is designed for Hartmann wavefront sensor with horizontal multi-channel pixel output. The structure is composed of multiplier groups, accumulation cells and dividers. The cells are designed according to the number of output channels and the output pixels’sequence. The centroid calculation latency in one frame is only the calculation time needed for the pixels output at the last pixel clock. In the simulation, when output channels’number is 8 and pixels output at 80MHz clock, centroid calculation latency is less than 0.5μs.
Key wordscentroid computation    parallel pixel output    programmable logic devices    Hartmann wavefront sensor
年卷期日期: 2016-04-10      出版日期: 2017-11-10
:  TP212  
作者简介: 宋璐,女,河南洛阳人,硕士,助教,研究方向:数字逻辑电路的应用设计和教学。
引用本文:   
宋璐, 王少白. 多通道像素并行输出哈特曼波前传感器 的实时质心运算流水线架构设计[J]. 电脑与电信, 2016, 1(4): 69-71.
Song Lu, Wang Shaobai. Pipeline Structure Design for Real-time Centroid Calculation of HartmannWavefront Sensor with Parallel Multi-channel Pixel Output. Computer & Telecommunication, 2016, 1(4): 69-71.
链接本文:  
https://www.computertelecom.com.cn/CN/  或          https://www.computertelecom.com.cn/CN/Y2016/V1/I4/69
[1] 曾清乐, 宋文强, 李敬磊. 基于UVM 的FPGA 测试技术的研究[J]. 电脑与电信, 2016, 1(5): 65-67.
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