基于FPGA的增强型MC8051的设计

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摘要本文通过对Oregano Systems公司提供的完整MC8051VHDL代码进行修改，增加PLL锁相环，将内部RAM扩大到256B，将定时器，串口和外部中断等资源扩大一倍，增加乘法器和除法器以得到增强型的51核。

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	刘绍铭

关键词 ： FPGA, Oregano Systems, MC8051

Abstract：The paper modifies the mc8051VHDL code offered by the Oregano Systems to add the PLL loop，to increase the internal RAM to be 256B，and to double the timer，serial ports and external interrupts. It also adds the multiplier and divider for the enhanced 51 nuclei．

Key words：　FPGA Oregano Systems MC8051

收稿日期: 1900-01-01 年卷期日期: 2011-02-10 出版日期: 2011-02-10

引用本文:

刘绍铭. 基于FPGA的增强型MC8051的设计[J]. , 2011, 1(02): 0-0.
Liu Shaoming. Design of the Enhanced MC8051 Based on FPGA. , 2011, 1(02): 0-0.

链接本文:

http://www.computertelecom.com.cn/CN/ 或 http://www.computertelecom.com.cn/CN/Y2011/V1/I02/0

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